Analyseur Logique
L’analyseur logique est un instrument de mesure electronique permettant de connaitre l'évolution binaire ( 0 ou 1 ) de signaux  sur un groupe de lignes de communications ( organisé en bus de données ).  Il comporte une mémoire d'acquisition pour enregistrer les évolutions des différents états logiques en temps réel de chacune des lignes. Cette mémoire est alimentée par des circuits de capture qui déterminent les états binaires en fonction d'un seuil ( TTL, CMOS ou définissable ), qui échantillonnent les signaux avec un cadencement fourni par une horloge interne ( acquisition asynchrone)  ou externe ( acquisition synchrone ). Un système de déclenchement par reconnaissance d'une patterne de bits permet de figer une acquisition afin de pouvoir ensuite éxaminer les résulats.
Les données sont ensuite présentées à l'utilisateur soir sous la forme d'un diagramme temporel, permettant de vérifier les concordances de temps, d'observer des parasites ou des transitions d'états incorrectes.


Elles peuvent également être présentées en tableaux de valeurs binaires, décimales, octales ou hexadécimales évoluant au fil du temps, ce qui permet de controler les valeurs numériques transportées  ( données, commandes, instructions, status etc.)
Cette représentation permet aussi le décodage de protocoles de communication selon les standards  I²C, RS232, CAN, SPI etc.

                          

Les oscilloscopes MSO (Mixed Signal Oscilloscopes) permettent en plus de la  mesure de l'evolution analogiques de quelques signaux, de mesurer l'évolution binaire sur un groupe de signaux plus important (16 voies). Ils ne permettent pas de faire d'acquisition synchrone, mais effectuent aussi le décodage de protocoles de communication selon les standards  I²C, RS232, CAN, SPI etc.


 
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